傳輸觸發(fā)體系結構處理器的軟件流水.pdf_第1頁
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文檔簡介

1、Transport Triggered Architecture(TTA) 是一種調度自由度非常大的體系結構。指令集并行性的開發(fā)不僅限于操作級水平更擴展到了數(shù)據(jù)傳輸級水平。多TTA 核經常被用做協(xié)處理器來進行一些計算量較大的數(shù)學運算。所以多TTA 核上的軟硬件劃分和任務級流水調度對系統(tǒng)性能影響很大。軟件流水是一種能夠大大提升代碼質量的編譯器優(yōu)化方法，利用重疊loop 起始指令的方式來開發(fā)指令級并行性。在多TTA 架構處理器上的軟硬件劃分

2、，任務級流水和軟件流水還沒有得到工業(yè)界和學術界的重視。在這些已經存在工作當中，一些直覺性的啟發(fā)式算法得到廣泛應用，但是這些啟發(fā)式算法并不能保證代碼質量落在一個合理的優(yōu)化范圍之內。 在這篇文章中，我們提出了一種新的基于整數(shù)線性編程的公式來計算TTA 架構處理器上的軟件流水。我們提出的公式是面向有資源限制啟動最優(yōu)并且loop 消耗最小的TTA 架構處理器上的軟件流水。這些整數(shù)線性編程的公式將由GLPK 經計算解出。我們把這種方法應用

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