跨時鐘域信號同步技術研究.pdf_第1頁
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文檔簡介

1、在現(xiàn)代ASIC以及FPGA設計中，在EDA軟件工具的幫助下，已經可以使設計規(guī)模達到千萬門級甚至更大的規(guī)模。然而對于在兩個不同的時鐘域之間正確地傳遞數(shù)據(jù)，至今是軟件工具無法自動完成的，設計人員必須人為地加入某種機制，來保證這種數(shù)據(jù)傳遞的正確性，這就是本文要討論的核心內容——跨時鐘域信號的同步。本文系統(tǒng)地闡述了跨時鐘域數(shù)據(jù)傳遞的機理，從其原理出發(fā)，研究分析了數(shù)字電路中不同的同步機制的工作模式，并進行了模擬仿真，比較了它們的優(yōu)缺點。針對使用廣

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