16位音頻Σ-Δ調(diào)制器的設(shè)計與實現(xiàn).pdf_第1頁
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文檔簡介

1、近年來隨著大規(guī)模集成電路與數(shù)字信號處理技術(shù)、計算機技術(shù)的發(fā)展,高精度模數(shù)轉(zhuǎn)換器的需求越來越大。Σ-ΔADC是一種采用過采樣、噪聲整形以及數(shù)字降采樣濾波技術(shù)來實現(xiàn)高精度的模數(shù)轉(zhuǎn)換器。相比于傳統(tǒng)的NyquistADC,Σ-ΔADC降低了對模擬電路性能以及器件匹配的要求,易于采用標準CMOS工藝實現(xiàn)低成本、低功耗和高精度。本文所研究的主要內(nèi)容是利用開關(guān)電容技術(shù)來實現(xiàn)16bits音頻Σ-ΔADC中調(diào)制器的設(shè)計。主要研究內(nèi)容及成果如下:
　

2、　(1)在深入理解Σ-ΔADC的基本原理以及查閱了大量文獻后,分析了Σ-Δ調(diào)制器的拓撲結(jié)構(gòu),根據(jù)所設(shè)計的16bits音頻Σ-Δ調(diào)制器的精度要求,最終確立采用1位量化、三階單環(huán)、前饋型Σ-Δ調(diào)制器的電路結(jié)構(gòu)。
　　(2)在MATLAB中導(dǎo)入delta-sigma toolbox,編寫程序設(shè)計出所采用調(diào)制器結(jié)構(gòu)的級間系數(shù)。分析了影響Σ-Δ調(diào)制器性能的主要非理想性因素,在MATLAB/Simulink中完成了非理想條件下的Σ-Δ調(diào)制器的

3、系統(tǒng)級設(shè)計,仿真結(jié)果表明調(diào)制器具有108.2dB的信噪比,有效位為17.67bits。
　　(3)根據(jù)系統(tǒng)級設(shè)計確定的參數(shù),采用開關(guān)電容技術(shù),完成了調(diào)制器各個組成模塊的電路設(shè)計,包括一種A類跨導(dǎo)運算放大器(OTA)、1bit量化器、兩相非交疊時鐘發(fā)生器、CMOS開關(guān)、反饋DAC、帶隙基準電壓源以及偏置電路等,并最終完成了整個調(diào)制器的電路設(shè)計。
　　(4)在Cadence/Virtuoso中完成了調(diào)制器各個電路模塊的版圖以及整

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