高速互連中的信號完整性分析與測試技術研究.pdf_第1頁
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文檔簡介

1、隨著電路系統(tǒng)規(guī)模越來越大、工藝尺寸越來越小、工作速度越來越快、時鐘頻率越來越高,電路系統(tǒng)已進入高速系統(tǒng)時代。在高速電路中的互連線呈現(xiàn)出傳輸線效應,互連線間的耦合噪聲對電路傳輸性能的影響日益突出,由此引起的信號完整性故障已成為高速電路設計、分析時不容忽視的問題。
　　針對信號完整性問題,本文主要從理論分析和仿真驗證兩個方面進行研究。首先對理想傳輸線的基本理論、結(jié)構(gòu)和相關參數(shù)等特性進行理論分析。其次對信號完整性中的基本理論進行梳理,重

2、點對其中的串擾理論進行分析,探討了基于容性耦合與感性耦合的串擾產(chǎn)生機理,分析了理想互連線的幾何尺寸、布線間距、耦合長度、攻擊線數(shù)目等因素對串擾的影響并通過Hspice進行了仿真驗證,詳細分析了三種常見的串擾故障激勵模型。接著對高速互連中信號完整性檢測方法進行研究,詳細分析了幾種具有代表性的信號完整性檢測單元的電路結(jié)構(gòu)和測試機理,并通過軟件進行了仿真驗證。最后在以上分析的基礎上提出了自己設想:參照已有的信號完整性檢測單元和邊界掃描(JTA

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