可共享多通道Cache設(shè)計及存儲體系的CPN建模與驗證.pdf_第1頁
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1、分類號!里三Q2UDC論文題目密級編號1012631109022研究生：旦瞳壹指導(dǎo)教師：割墅薹副斂捶專業(yè)：讓箕扭科堂皇撞丕研究方向：讓篡扭丞統(tǒng)結(jié)撿所在學(xué)院讓箕扭堂隨2014年5月4日內(nèi)蒙古大學(xué)碩士學(xué)位論文可共享多通道Cache設(shè)計及存儲體系的CPN建模與驗證摘要片上多核處理器體系結(jié)構(gòu)因其低設(shè)計復(fù)雜度、高性能、低功耗等特性成為當(dāng)今主流的處理器架構(gòu)。但片上高度集成給各內(nèi)核的高速并發(fā)訪問帶來了巨大的壓力，而多核處理器結(jié)構(gòu)設(shè)計的優(yōu)劣直接影響系統(tǒng)

2、的性能。其中CMP存儲體系的設(shè)計占有極其重要的地位：CMP存儲體系可緩解處理器與外存的速度差，同時對核間通信有巨大作用，其存儲操作直接影響數(shù)據(jù)的安全可靠性。為了提高數(shù)據(jù)訪問的并行性，為數(shù)據(jù)的存儲與傳輸提供更快速的路徑，本文提出一種面向多核的共享多通道Cache體系原型ArchitectureutilizingMultiChannelCache，簡稱為AUMCC。本文對該體系進(jìn)行了具體設(shè)計，主要包括共享多通道Cache的映射機(jī)制設(shè)計、存儲

3、架構(gòu)的Cache一致性協(xié)議設(shè)計以及對共享多通道Cache的并發(fā)訪問沖突處理機(jī)制的設(shè)計。分析了該體系在提高數(shù)據(jù)存儲和傳輸?shù)牟⑿行?、提高核間通信效率以及簡化一致性維護(hù)的優(yōu)勢。然后為全相聯(lián)映射的AUMCC體系(FAA【MCC)建立層次化CPN模型，并使用CPN工具對模型進(jìn)行了仿真執(zhí)行，同時對模型正確性和可行性進(jìn)行了驗證。通過對模型的正確性和可行性的驗證證明了FA—AUMCC體系的可實現(xiàn)性。關(guān)鍵字：多核存儲體系；并行性；AUMCC體系設(shè)計；CP

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